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Detailed Description
1. Virtex-5 FPGA
A Xilinx Virtex-5 FPGA is installed on the board. See Appendix A, “Board Revisions” for
device details.
Configuration
The board supports configuration in all modes: JTAG, Master Serial, Slave Serial, Master
SelectMAP, Slave SelectMAP, Byte-wide Peripheral Interface (BPI) Up, BPI Down, and SPI
modes. See the “Configuration Options,” page 53 section for more information.
I/O Voltage Rails
Table 1-1 summarizes the FPGA I/O voltage rail and the voltages applied to each bank.
Table 1-1:
I/O Voltage Rail of FPGA Banks
FPGA Bank
0
1
2
3
4
5 (1)
6
11
12
13
15
17
18
19
20
21
22
23 (1)
25
I/O Voltage Rail
3.3V
3.3V
3.3V
2.5V no DCI
3.3V no DCI
3.3V DCI with 49.9 Ω resistors installed
3.3V (unused)
User selectable as 2.5V or 3.3V using jumper J20
3.3V DCI with 49.9 Ω resistors installed
User selectable as 2.5V or 3.3V using jumper J20
1.8V DCI with 49.9 Ω resistors installed
1.8V DCI with 49.9 Ω resistors installed
3.3V no DCI
1.8V DCI with 49.9 Ω resistors installed
3.3V DCI with 49.9 Ω resistors installed
1.8V DCI with 49.9 Ω resistors installed
3.3V DCI with 49.9 Ω resistors installed
3.3V DCI with 49.9 Ω resistors installed
3.3V (unused)
Notes:
1. Banks 5 and 23 are available on the ML507 only.
ML505/ML506/ML507 Evaluation Platform
UG347 (v3.1.2) May 16, 2011
www.xilinx.com
17
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I-JET JTAG ARM DEBUGGING PROBE
IAC24A INPUT MODULE AC 5MA 24VDC
IAC5EQ INPUT MODULE AC 10MA 5VDC
IB8RM SURGE SUPP 8OUT 12'CORD W/REMOTE
IBAR12-20T SURGE SUPPRSSR 20A 12OUT RACKMNT
相关代理商/技术参数
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